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VHDL : Lenguaje para síntesis y modelado de circuitos / Fernando Pardo Carpio

By: Contributor(s): Material type: TextTextPublication details: México : AlfaomegaEdition: 3 ed. ActualizadaDescription: 308 pISBN:
  • 978-607-707-174-7
Subject(s): DDC classification:
  • 621.392 P226v 2011
Contents:
Metodología de diseño.-- Descripción del diseño.-- Introducción al lenguaje VHDL.-- Elementos sintácticos del VHDL.-- Descripción del flujo de datos.-- Descripción comportamental algorítmica.-- Descripción estructural.-- Poniendo orden: subprogramas, paquetes y bibliotecas.-- Conceptos avanzados en VHDL.-- Evolución del VHDL.-- VHDL para simulación.-- VHDL para síntesis.-- Utilización del lenguaje VHDL
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Incluye bibliografía e índice alfabético

Metodología de diseño.-- Descripción del diseño.-- Introducción al lenguaje VHDL.-- Elementos sintácticos del VHDL.-- Descripción del flujo de datos.-- Descripción comportamental algorítmica.-- Descripción estructural.-- Poniendo orden: subprogramas, paquetes y bibliotecas.-- Conceptos avanzados en VHDL.-- Evolución del VHDL.-- VHDL para simulación.-- VHDL para síntesis.-- Utilización del lenguaje VHDL

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